HM55上电时序详解

HM55上电时序详解
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资料在哪里啊？？？？
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我也是在找啊，谁有快出来露两手

等高人的出现

INTEL五系列芯片组不同时序

SLP_S3#

SLP_M#桥发出的用于开启 ME 模块供电的控制信号，3.3V
如果主板有 ME 固件，开启 AMT 功能时，此信号会在触发前就产生；关闭 AMT 功能时时序与 SLP_S3#一致
如果主板不支持 AMT 功能，SLP_M#悬空不采用

SLP_LAN#：LAN 子系统休眠控制，控制网卡供电，与 SLP_M#时序同步
* p( D$ T9 X! n3 V9 h" z; L. _
VCCME：1.05V    ME 模块的供电（即实现 AMT 功能的供电），受控于 SLP_M#。SLP_M#悬空时（主板无 ME 固件）， VCCME 直接采用 S0 状态的供电
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$ s( L! L  U7 K8 xVDIMM：指内存供电，受控于 SLP_S4#

VCC：指桥的主供电等 S0 状态的电压，受控于 SLP_S3#
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VCC_CPU:主板给 CPU 的核心供电，受控于 SLP_S3#,有延时
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SYS_PWROK：由 CPU 的电源管理芯片发给桥的 3.3V 高电平，等同于 VRMPWRGD
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; C; S& F# {0 {, M* E) xPWROK：主板发给桥的 3.3V 高电平，表示 S0 状态电压都 OK
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5 P) p( N/ r+ wMEPWROK：ME 模块电源好，3.3V，开启 AMT 功能时，MEPWROK 由 AMT 电控制，关闭 AMT 功能时，MEPWROK与 PWROK 同步

9 ]6 T) p- S6 O% X5 w- `LAN_RST#：主板发给桥的集成网卡复位信号，可以理解为网卡的电源好信号
- [( t) H$ i, E0 D+ Z4 T8 q, {
; q# |3 s5 J- M# z- [Clock Chip Outputs：时钟芯片被开启，输出各组时钟
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PROCPWRGD：桥发出给 CPU 的 PG，表示 CPU 的核心电压 OKS
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( o& N3 ~# ?9 ?4 x. {+ @$ RDRAMPWROK：桥发给 CPU 的 PG，通知 CPU，内存模块供电 OK
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- ^# y1 f; Z: |0 G2 b3 ^; _# ^  |PLTRST#:桥发出的平台复位 3.3V，经过转换作为 CPU 复位
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HM55/HM65时序区别

HM5X相对于ICH的时序特点：

1、  增加了SLP_M#（从ICH8开始就增加了），用于控制ME模块供电，但大部分机器不采用

2、增加了SLP_LAN#,用于控制网卡的供电（跟随SLP_M#的状态）

2、  增加了VCCME，给ME模块供电，1.05V（不支持AMT时，VCCME与总线供电是一起的）

3、  把VRMPWRGD更名为SYS_PWROK

4、  增加了MEPWROK（ICH时叫CLPWROK）,不支持AMT的时候，MEPWROK会跟PWROK连一起

6、CPUPWRGD变为两个信号：DRAMPWROK、PROCPWRGD

HM6X/7X相对于HM5X的时序区别：

1、增加了VCCDSW3_3、DPWROK、SLP_SUS#,用于支持深度睡眠，但大部分机器不采用

2、SLP_M#更名为SLP_A#

3、VCCME更名为VCCASW

4、MEPWROK更名为APWROK

5、CPU供电时序推后了,它是在CPU得到PROCPWRGD后，发出SVID控制产生         

6、桥发出PWOCPWRGD的条件：供电正常、PWROK正常、时钟正常、能正确读取BIOS

7、取消了PCIRST#，桥只发出PLTRST#

8、集显供电一般是需要在跑码之后，过了内存才会产

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