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GA-A55M-DS2时序分析
一、待机
1.电池正极VBAT_2通过电阻RB改名为VBAT,一路送到IO检测电池电量,另一路送到PQ1正极,从负极输出过PR28电阻改名为RTCVDD。
2.RTCVDD第一路送到CLR_CMOS跳线。第二路送到FCH的E6脚,给FCH内部的CMOS存储器供电。第三通过PR27将INTRUDER_ALERT#拉为高电平。
3.FCH给PX1晶振供电,晶振起振产生32.768KHz频率给FCH,FCH内部CMOS电路开始工作。
4.接上市电,ATX电源输出5VSB待机供电,经PQ2降压为3.3V的3VDUAL_SB电压,给FCH和IO芯片提供待机供电。
5.FCH输出S5_CORE_EN信号给UU5芯片,开启UU5芯片工作将3VDUAL_SB降压得到1.1V的VCC11_DUAL,给FCH提供第二个待机供电。
6.VCC11_DUAL通过PQ9、PQ6转换,再经PR91上拉得到3.3V高电平的-RSMRST信号给FCH,表示主板待机供电正常。
二、触发
1.短接开关产生101跳变的-PWRBTSW信号送到IO的106脚。
2.IO芯片经内部逻辑转换从103脚输出101跳变的-PSOUT信号给FCH的J4脚(请求上电)。
3.FCH待机条件正常并且收到-PSOUT后,依次发出高电平的SLP_S5-和-SLP_S3信号。SLP_S5_信号去开启内存供电电路工作,-SLP_S3信号送到IO芯片102脚表示允许上电。
4.IO芯片通过内部逻辑转换从107脚输出持续低电平的-ATX_PSON信号,送到ATX电源接口。
5.ATX电源绿线被拉低后,电源开始工作输出12V、5V、3.3V等供电,完成上电。
三、供电
AMD单桥主板供电顺序:待机---内存---VDDA---CPU---VCCSB/VDDP/VDDR
1.内存供电
U99的5脚得到VCC供电,1脚得到BOOT供电,7脚得到高电平的DDR15V_EN信号后,芯片开始工作,从2脚和4脚分别输出上下管驱动信号,控制Q25和Q26工作,将5VDUAL降压得到DDR15内存供电。
2.VCCA25供电
VCC3给Q62的1脚供电,再给3脚开启信号,Q62工作从5脚输出VDDA25电压给CPU。
3.CPU供电
VCC给U2的10脚、29脚、42脚供电,芯片内部给BOOT脚供电,CPU发出VID信号给U2的5、6脚。
ATX电源输出PWOK信号送到Q54的B极,DDR15V送到Q59的B极,Q54、Q59同时导通,拉低Q431的G极电压,使Q431截止,经R335电阻上拉得到高电平的CPUVDD_EN信号,送到U2的24脚,开启U2工作控制后级电压降压得到VCORE和VCORE_NB供电。当供电正常后U2从37输出VCORE_PWROK信号通过电阻上拉为3.3V高电平。
4.桥供电
VCORE_PWOK通过Q58和Q278转换为SB_VCC_EN信号。
2.5V的2_5LEVEL经PR19和PR38分压得到1.13V电压,给SB_VCC_EN 上拉,送到PU3A的3脚,3脚电压大于2脚电压,1脚输出高电平,控制PQ3、PQ4工作将DDR15V降压得到VCC_SB给FCH供电。
5.PCI-E供电
2.5V的2_5LEVEL经PR61和PR102分压得到1.2电压,送到PU3B的5脚,5脚电压大于6脚电压,7脚输出高电平,控制Q24、Q27工作将DDR15V降压得到APU_VDDPA给APU供电。(APU_VDDPA给APU的VDDR、VDDP点供电,VDDR---内存控制器供电,VDDP----PCIE供电)
四、时钟
大部单桥主板,使用桥内部集成的时钟电路发出时钟信号。但技嘉的这个板使用了外置时钟芯片发出时钟信号。主板上电后VCC3给时钟芯片供电,时钟芯片给KX1晶振供电,晶振起振产生14.318MHz频率给时钟芯片。VCC3通过KR5电阻给时钟芯片的 52脚一个高电平的EN信号。时钟芯片开始工作输出各组时钟信号给主板各个设备。
五、复位
1.VCC_SB、RESET、-SLP_S3信号同时加到Q63的B极,控制Q63导通,使Q64截止,经PR83电阻上拉得到高电平的SB_PWROK信号给FCH,表示主板供电正常。
2.FCH从E26脚发出CPU_PG_SB信号,通过AQ3、AQ5转换为高电平的CPU_PWRGD信号,送给APU表示主板供电正常。
3.FCH从AD5脚发出-A_RST信号复位IO芯片,再从AE2脚发出APUPCIE_RST信号复位网卡和PCI-E插槽。
4.FCH从AB5脚发出-PPCIRST信号复位PCI插槽。
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